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EEPW首頁(yè) >> 主題列表 >> asic ip核

基于Nios II的過程控制實(shí)驗(yàn)裝置的研究

  • 利用SOPC強(qiáng)大的IP核和容易配置的優(yōu)勢(shì)簡(jiǎn)化設(shè)計(jì)流程。充分發(fā)揮NiosⅡ強(qiáng)大的并行處理能力。該系統(tǒng)主要涉及多個(gè)下位機(jī)與FPGA的通信問題。
  • 關(guān)鍵字： SOPC  IP核  NiosII  

MCUUSB設(shè)備控制器IP核的設(shè)計(jì)

  • 本論文針對(duì)USB1.1 協(xié)議規(guī)范，本著自主開發(fā)USB控制芯片，把MCU 和USB 設(shè)備控制器用軟核的形式集成在一塊芯片上，微控制器我們是用14 位指令字長(zhǎng)度，且是單字節(jié)指令和單周期指令，其核心指令只有 39 條，容易掌握和設(shè)計(jì)，而且完全滿足總體設(shè)計(jì)的要求。
  • 關(guān)鍵字： USB控制芯片  IP核  MCU  

基于FPGA 的二維提升小波變換IP核設(shè)計(jì)

  • 提出了一種高效并行的二維離散提升小波(DWT)變換結(jié)構(gòu)，該結(jié)構(gòu)只需要7 行數(shù)據(jù)緩存，即可實(shí)現(xiàn)行和列方向同時(shí)進(jìn)行濾波變換。
  • 關(guān)鍵字： 小波變換  數(shù)據(jù)緩存  FPGA  IP核  

面積優(yōu)先的分組密碼算法SMS4 IP核設(shè)計(jì)

  • 對(duì)新分組密碼算法SMS4進(jìn)行了FPGA實(shí)現(xiàn)。所設(shè)計(jì)的SMS4算法的IP核主要包括具有加解密功能的非流水線式數(shù)據(jù)通路和實(shí)時(shí)產(chǎn)生子密鑰的密鑰擴(kuò)展模塊，并且支持電子密碼本(ECB)和分組鏈接(CBC)兩種工作模式。提出了一種不含密鑰初始化的運(yùn)行模式，使解密吞吐率提高近一倍。
  • 關(guān)鍵字： 分組密碼  IP核  FPGA  

基于Avalon-ST接口幀讀取IP核的設(shè)計(jì)和應(yīng)用

  • 研究基于Avalon-ST接口幀讀取的IP核設(shè)計(jì)應(yīng)用，通過Avalon-ST接口將外部存儲(chǔ)中不同格式的幀數(shù)據(jù)轉(zhuǎn)化為視頻流輸出。根據(jù)Avalon總線協(xié)議及Avalon-ST視頻協(xié)議研究設(shè)計(jì)方案，使用Verilog HDL語(yǔ)言對(duì)模塊進(jìn)行硬件設(shè)計(jì)，并將實(shí)現(xiàn)的模塊進(jìn)行測(cè)試。
  • 關(guān)鍵字： Avalon-ST  IP核  Verilog  

有功電能計(jì)量IP核的設(shè)計(jì)

  • 對(duì)有功電能計(jì)量的數(shù)學(xué)模型進(jìn)行了分析，給出了相應(yīng)的IP核實(shí)現(xiàn)模型，并詳細(xì)討論了CIC抽取濾波器、IIR高通濾波器、FIR低通濾波器、數(shù)字頻率變換等模塊的原理與設(shè)計(jì)。
  • 關(guān)鍵字： 有功電能  CycloneII  IP核  

基于FPGA的二-十進(jìn)制轉(zhuǎn)碼器設(shè)計(jì)

  • 針對(duì)二進(jìn)制轉(zhuǎn)十進(jìn)制(BCD)轉(zhuǎn)碼器的FPGA實(shí)現(xiàn)目標(biāo)，提出了一種高效、易于重構(gòu)的轉(zhuǎn)碼器設(shè)計(jì)方案。并在FPGA開發(fā)板上成功地實(shí)現(xiàn)了該設(shè)計(jì)。
  • 關(guān)鍵字： BCD轉(zhuǎn)碼器  IP核  路徑延遲  

在選用FPGA進(jìn)行設(shè)計(jì)時(shí)如何降低功耗

  • 傳統(tǒng)意義上，ASIC和CPLD是低功耗競(jìng)爭(zhēng)中當(dāng)仁不讓的贏家。但是由于相對(duì)成本較高，且用戶對(duì)高端性能和額外邏輯的要求也越來(lái)越多，在低功耗應(yīng)用中使用CPLD正在失去優(yōu)勢(shì)。ASIC也面臨相同的風(fēng)險(xiǎn)。而例如FPGA這樣日益增長(zhǎng)的可編程半導(dǎo)體器件正逐步成為備受青睞的解決方案。
  • 關(guān)鍵字： 低功耗  ASIC  CPLD  可編程半導(dǎo)體器件  

FPGA并行計(jì)算抽象接口的設(shè)計(jì)與實(shí)現(xiàn)

  • 本設(shè)計(jì)為基于C語(yǔ)言開發(fā)的程序開發(fā)了一個(gè)FPGA的并行計(jì)算接口，凡是以C語(yǔ)言設(shè)計(jì)的程序，均可通過調(diào)用本設(shè)計(jì)的接口，把復(fù)雜的算法、數(shù)值處理交給FPGA芯片完成，在不需要程序員學(xué)習(xí)FPGA知識(shí)以及使用FPGA開發(fā)工具的前提下，大大地減輕CPU的負(fù)荷以及從根本上提高了程序的執(zhí)行效率，是FPGA并行化應(yīng)用的一次全新嘗試。
  • 關(guān)鍵字： IP核  調(diào)度模塊  FPGA  PCI設(shè)備驅(qū)動(dòng)  Express總線  

基于FPGA的3D圖像處理器IP核的實(shí)現(xiàn)

  • LCD顯示屏的應(yīng)用越來(lái)越廣，數(shù)量越來(lái)越多。LCD顯示屏應(yīng)用廣泛,無(wú)處不在。如家庭各種電器設(shè)備。更常見是用于各種公共場(chǎng)合如體育館、廣場(chǎng)等商業(yè)用途。給我們傳遞一種更為直觀、生動(dòng)的信息。從此我們的生活發(fā)生了巨大改變。巨大的應(yīng)用巨大的市場(chǎng)帶來(lái)了巨大的商機(jī)?；贔PGA的LCD顯示的3D影像是為了LCD顯示屏的信息量更多，滿足人需求。
  • 關(guān)鍵字： IP核  3D圖像處理器  FPGA  LCD  Verilog  

如何用C語(yǔ)言描述AES256加密算法最高效？

  • 高級(jí)加密標(biāo)準(zhǔn) (AES) 已經(jīng)成為很多應(yīng)用（諸如嵌入式系統(tǒng)中的應(yīng)用等）中日漸流行的密碼規(guī)范。
  • 關(guān)鍵字： ASIC  AES  FPGA  嵌入式  

可配置電源管理ASIC--當(dāng)今的系統(tǒng)黏合劑

  • 上個(gè)世紀(jì)，在數(shù)字化思維主導(dǎo)設(shè)計(jì)領(lǐng)域時(shí)，系統(tǒng)是標(biāo)準(zhǔn)處理器，ASSP，模擬電路和黏合邏輯的混合物?！梆ず线壿嫛笔峭ㄟ^小型和中型集成電路把不同數(shù)字芯片的協(xié)議和總線連在一起。為了降低成本實(shí)現(xiàn)一體化，“黏合邏輯”曾經(jīng)風(fēng)靡整個(gè)ASIC業(yè)。
  • 關(guān)鍵字： 集成電路  ASIC  電源管理  

基于FPGA的信息安全系統(tǒng)設(shè)計(jì)

  • 本模塊采用xilinx公司的Spartan 3E系列XC3S500E型FPGA作為核心控制芯片，對(duì)采集到底模擬信號(hào)進(jìn)行數(shù)字轉(zhuǎn)換后通過3DES算法進(jìn)行加密、然后通過網(wǎng)絡(luò)傳輸，再經(jīng)過解密算法解密出明文數(shù)據(jù)。
  • 關(guān)鍵字： 信息安全系統(tǒng)  RAM  IP核  FPGA  乒乓操作  

MEMS麥克風(fēng)技術(shù)滿足音量市場(chǎng)的性能要求

  • 隨著智能設(shè)備的迅猛發(fā)展，市場(chǎng)需要更高性能的麥克風(fēng)，而MEMS可以在緊湊的尺寸內(nèi)麥克風(fēng)提供高性能和保真度及可靠性，適用于便攜式設(shè)備。本文介紹了MEMS麥克風(fēng)的結(jié)構(gòu)和工作模式，并介紹了相關(guān)的MEMS麥克風(fēng)套件。
  • 關(guān)鍵字： MEMS  麥克風(fēng)  ASIC  201706  

ASIC設(shè)計(jì)中不可忽視的幾大問題

  • 　　ASIC的復(fù)雜性不斷提高，同時(shí)工藝在不斷地改進(jìn)，如何在較短的時(shí)間內(nèi)開發(fā)一個(gè)穩(wěn)定的可重用的ASIC芯片的設(shè)計(jì)，并且一次性流片成功，這需要一個(gè)成熟的ASIC的設(shè)計(jì)方法和開發(fā)流程?！　”疚慕Y(jié)合NCverilog，DesignCompile，Astro等ASIC設(shè)計(jì)所用到的EDA軟件，從工藝獨(dú)立性、系統(tǒng)的穩(wěn)定性、復(fù)雜性的角度對(duì)比各種ASIC的設(shè)計(jì)方法，介紹了在編碼設(shè)計(jì)、綜合設(shè)計(jì)、靜態(tài)時(shí)序分析和時(shí)序仿真等階段經(jīng)常忽視的問題以及避免的辦法，從而使得整個(gè)設(shè)計(jì)具有可控性。　　    　
  • 關(guān)鍵字： ASIC  
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