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EEPW首頁 >> 主題列表 >> asic-to-fpga

基于FPGA的說話人識別系統(tǒng)，包含原理圖、源代碼

  • 隨著網(wǎng)絡(luò)信息化技術(shù)的迅猛發(fā)展，身份驗證的數(shù)字化、隱性化、便捷化顯得越來越重要。語言作為人類的自然屬性之一，說話人語言具有各自的生物特征，這使得通過語音分析進(jìn)行說話人識別（Speaker Recognition, RS）成為可能。
  • 關(guān)鍵字： 語音識別系統(tǒng)  matlab  FPGA  最小距離算法  

基于FPGA的運動鞋專用數(shù)據(jù)發(fā)送芯片及競走電子裁判的設(shè)計與實現(xiàn)

  • 我們以電子競技裁判為切入點，將該特性普及化、應(yīng)用于生活運動領(lǐng)域。本設(shè)計在每個競走運動員的鞋子上都安裝加速度傳感器，在競走過程中，將采集到的加速度數(shù)據(jù)通過射頻發(fā)送給基于FPGA芯片設(shè)計的電子裁判，把復(fù)雜的算法、數(shù)據(jù)處理交給FPGA芯片完成，讓電子裁判進(jìn)行判斷。
  • 關(guān)鍵字： 加速度傳感器  射頻芯片  FPGA  PCI控制器  電子裁判  

利用FPGA實現(xiàn)無線分布式采集系統(tǒng)設(shè)計

  • 在無線分布式采集系統(tǒng)設(shè)計中，采用了基于卷積編碼、Viterbi譯碼的編碼和互為備份的雙通道傳輸方案，利用了FPGA內(nèi)豐富的邏輯資源以及存儲資源，實現(xiàn)了數(shù)據(jù)的遠(yuǎn)距離同步可靠傳輸。
  • 關(guān)鍵字： 無線分布  Viterbi  FPGA  采集系統(tǒng)  卷積編碼  

FPGA入門基礎(chǔ)與項目實踐，拿下FPGA，輕松簡單！

  • 著眼于目前發(fā)展火熱的FPGA技術(shù)，它需要工程師們熟練地掌握設(shè)計工具，深刻理解FPGA的內(nèi)在結(jié)構(gòu)及靈活運用設(shè)計語言，從而能夠有效地完成復(fù)雜的設(shè)計任務(wù)。在此總結(jié)了FPGA基礎(chǔ)教程與項目實踐，希望各位網(wǎng)友看后能舉一反三，完成從入門到精通的技術(shù)飛躍。
  • 關(guān)鍵字： PCB  數(shù)字示波器  FPGA  STM32  最小系統(tǒng)  

基于FPGA的多路CameraLink數(shù)據(jù)的WDM光傳輸

  • 本系統(tǒng)是基于FPGA的多路CameraLink數(shù)據(jù)的單光纖傳輸設(shè)計，由于FPGA的開發(fā)成本低廉，升級方便所以成為該系統(tǒng)設(shè)計的選擇。
  • 關(guān)鍵字： CameraLink  多路  FPGA  WDM  光傳輸  

基于NETFPGA的可重構(gòu)科學(xué)計算平臺

  • 本項目的研究目標(biāo)是探索和建立圖形化數(shù)學(xué)算法向硬件轉(zhuǎn)換的理論方法，研究開發(fā)數(shù)學(xué)算法向硬件邏輯轉(zhuǎn)換的工具，與科學(xué)計算軟件相結(jié)合建立起基于FPGA陣列的科學(xué)計算平臺原型。研究目標(biāo)結(jié)構(gòu)流程如下：
  • 關(guān)鍵字： 可重構(gòu)  科學(xué)計算平臺  FPGA  NET  

基于FPGA的RS（255，239）編譯碼器設(shè)計

  • RS（Reed-Solomon）編碼是一種具有較強(qiáng)糾錯能力的多進(jìn)制BCH編碼，其既可糾正隨機(jī)錯誤，又可糾正突發(fā)錯誤。RS編譯碼器廣泛應(yīng)用于通信和存儲系統(tǒng)，為解決高速存儲器中數(shù)據(jù)可靠性的問題，文中提出了RS編碼的實現(xiàn)方法，并對編碼進(jìn)行了時序仿真。仿真結(jié)果表明，該譯碼器可實現(xiàn)良好的糾錯功能。
  • 關(guān)鍵字： 編譯碼器  寄存器  RS  FPGA  

基于多級SE網(wǎng)絡(luò)和混沌加密原理的FPGA設(shè)計與實現(xiàn)

  • ：提出了混沌加密算法為基礎(chǔ)核心，并結(jié)合多級Shuffle-Exchange網(wǎng)絡(luò)設(shè)計并實現(xiàn)一個高效的加密系統(tǒng)。在解決多條輸入數(shù)據(jù)通道因復(fù)用要求而造成訪問沖突的問題后，提高加密模塊冗余度，實現(xiàn)系統(tǒng)吞吐能力的提升和最佳配置需求。
  • 關(guān)鍵字： 混沌加密  多級SE網(wǎng)絡(luò)  FPGA  Shuffle-Exchange  

基于FPGA的實時金融指數(shù)行情并行計算

  • 本項目的研究成果除股票交易的并行加速模型與系統(tǒng)設(shè)計外，還包括對股票交易系統(tǒng)其它業(yè)務(wù)處理的硬件加速論證方案，根據(jù)計算任務(wù)特點不同，給出合理的硬件加速平臺建設(shè)方案，股票指數(shù)實時更新只是其中的一個應(yīng)用場景。
  • 關(guān)鍵字： 實時金融指數(shù)  并行計算  FPGA  PCI-Express  突發(fā)傳輸模式  

基于FPGA的手勢語音轉(zhuǎn)換器

  • 本文所設(shè)計的手勢語音識別器大大提高了殘疾人與正常人進(jìn)行交流溝通的方便性。系統(tǒng)的開發(fā)與利用將可以促進(jìn)手勢識別技術(shù)的發(fā)展，具有很強(qiáng)的實用性和廣闊的應(yīng)用前景。
  • 關(guān)鍵字： 手勢語音轉(zhuǎn)換器  面積篩選算法  背景圖像減法  FPGA  空間域法  

FPGA并行計算抽象接口的設(shè)計與實現(xiàn)

  • 本設(shè)計為基于C語言開發(fā)的程序開發(fā)了一個FPGA的并行計算接口，凡是以C語言設(shè)計的程序，均可通過調(diào)用本設(shè)計的接口，把復(fù)雜的算法、數(shù)值處理交給FPGA芯片完成，在不需要程序員學(xué)習(xí)FPGA知識以及使用FPGA開發(fā)工具的前提下，大大地減輕CPU的負(fù)荷以及從根本上提高了程序的執(zhí)行效率，是FPGA并行化應(yīng)用的一次全新嘗試。
  • 關(guān)鍵字： IP核  調(diào)度模塊  FPGA  PCI設(shè)備驅(qū)動  Express總線  

基于FPGA的混沌信號保密通信平臺的設(shè)計

  • 本項目基于FPGA技術(shù)進(jìn)行混沌信號保密通信平臺的設(shè)計。重點在于通信平臺的硬件電路設(shè)計，在軟件上采取VHDL硬件描述語言對每一部分的功能進(jìn)行模塊化設(shè)計，最后給出通信保密平臺的仿真驗證結(jié)果。
  • 關(guān)鍵字： 混沌保密通訊  Lorenz混沌吸引子  FPGA  多路傳播  

基于蜜罐技術(shù)的FPGA實現(xiàn)

基于FPGA的動態(tài)局部可重構(gòu)實現(xiàn)方法

  • 該實現(xiàn)方案借助嵌入式開發(fā)套件EDK建立一個處理器系統(tǒng)，同時借助Xilinx ISE工具建立一個頂層模塊，該頂層模塊包含了作為子模塊的處理器系統(tǒng)和同樣作為子模塊的局部重構(gòu)模塊。
  • 關(guān)鍵字： 動態(tài)局部可重構(gòu)  OPB總線  FPGA  PlanAhead  EDK  

基于FPGA的3D圖像處理器IP核的實現(xiàn)

  • LCD顯示屏的應(yīng)用越來越廣，數(shù)量越來越多。LCD顯示屏應(yīng)用廣泛,無處不在。如家庭各種電器設(shè)備。更常見是用于各種公共場合如體育館、廣場等商業(yè)用途。給我們傳遞一種更為直觀、生動的信息。從此我們的生活發(fā)生了巨大改變。巨大的應(yīng)用巨大的市場帶來了巨大的商機(jī)。基于FPGA的LCD顯示的3D影像是為了LCD顯示屏的信息量更多，滿足人需求。
  • 關(guān)鍵字： IP核  3D圖像處理器  FPGA  LCD  Verilog  
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