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EEPW首頁 >> 主題列表 >> fpga+dsp

基于FPGA的簡易微機的結(jié)構(gòu)分析與實現(xiàn)

  • 微型計算機的原理及結(jié)構(gòu)一般不易理解掌握，利用FPGA來學(xué)習(xí)并構(gòu)建一個簡易微型計算機無疑是一個好方法，對EDA的軟硬件學(xué)習(xí)也是一個不錯的選擇，可為將來進行相關(guān)ASIC沒計打下良好的基礎(chǔ)。
  • 關(guān)鍵字： 微型計算機  FPGA  EDA  

基于FPGA的高清圖像處理設(shè)計

  • FPGA解決方案可容易地支持超過HDTV要求的數(shù)據(jù)傳輸速率，這意味著一個器件可以支持所有這些格式，只需要根據(jù)設(shè)備的需要進行重新編程就可以了。這可減少企業(yè)的用料清單項目，同時還排除了ASSP供應(yīng)商可能存在的供貨風(fēng)險。
  • 關(guān)鍵字： 廣播格式  圖像處理  FPGA  

基于FPGA的光纖陀螺慣導(dǎo)系統(tǒng)溫控電路接口設(shè)計

  • 本文介紹了一種基于FPGA的光纖陀螺慣導(dǎo)系統(tǒng)溫控電路接口設(shè)計。主要說明了溫控電路整體結(jié)構(gòu),溫控電路工作流程,FPGA與外圍電路的通信接口和FPGA的邏輯設(shè)計等幾個方面。
  • 關(guān)鍵字： 溫控電路  光纖陀螺  FPGA  

基于FPGA的AVS解碼芯片驗證平臺

  • 針對AVS視頻解碼芯片仿真和驗證的要求，提出了基于FPGA的驗證平臺框架。該驗證平臺主要用于對AVS解碼芯片進行硬件模塊的驗證，從而為整個視頻解碼芯片的開發(fā)提供可靠的依據(jù)。該平臺基于Nios II軟核處理器，可使軟件模塊和硬件模塊在一個平臺下真正實現(xiàn)軟硬件協(xié)同工作?；谠撈脚_實現(xiàn)了多個硬件模塊和AVS視頻解碼芯片的驗證，其結(jié)果證明了該驗證平臺的正確性和可靠性。
  • 關(guān)鍵字： 視頻解碼  驗證平臺  FPGA  

基于FPGA的高精度時間數(shù)字轉(zhuǎn)換電路的設(shè)計與實現(xiàn)

  • 本文介紹一種基于 FPGA高精度時間數(shù)字轉(zhuǎn)換電路的設(shè)計方法，利用片內(nèi)鎖相環(huán)（PLL）和環(huán)形移位寄存器，采用不高的系統(tǒng)時鐘便可得到很高的時間分辨率，且占用較少邏輯資源?？勺鳛楣δ茈娐藩毩⑹褂?，也可作為 IP核方便地移植到其他片上系統(tǒng)（SOC）中。在 Altera公司的 Stratix和 Cyclone系列芯片上實現(xiàn)時，時間分辨率昀高可達 3.3ns。時序仿真和硬件測試表明該方法的可行性和準(zhǔn)確性。
  • 關(guān)鍵字： 時間數(shù)字轉(zhuǎn)換電路  激光探測  FPGA  

量程自整定高精度頻率測量的FPGA實現(xiàn)

  • 數(shù)字頻率計是一種應(yīng)用十分廣泛的電子測量儀表，針對寬頻率范圍被測信號頻率測量應(yīng)用需求，提出并實現(xiàn)了一種基于FPGA的自動量程切換高精度數(shù)字頻率計的設(shè)計方法。通過構(gòu)建測頻控制器、閘門同步生成器、量程自動切換等模塊，并采用Verilog HDL語言進行描述，運用自頂向下的數(shù)字系統(tǒng)設(shè)計方法實現(xiàn)了寬頻率范圍頻率測量的量程自動切換。在Xilinx公司的XUPV5-LX110T開發(fā)板上進行了測試，給出了系統(tǒng)后仿真波形。結(jié)果表明目標(biāo)系統(tǒng)能根據(jù)被測信號頻率范圍進行自動量程切換，實現(xiàn)高精度頻率測量，測量精度不低于10-7，
  • 關(guān)鍵字： 數(shù)字頻率計  自動量程切換  FPGA  

一種基于FPGA的雷達回波實時模擬器的實現(xiàn)

  • 提出了一種基于FPGA的雷達回波實時模擬器的實現(xiàn)方法。該模擬器采用cPCI標(biāo)準(zhǔn)總線，以FPGA為核心計算單元，配有高速數(shù)模、模數(shù)轉(zhuǎn)換模塊，可實現(xiàn)雷達回波信號實時在線注入模擬。該模擬器可實現(xiàn)多種體制下復(fù)雜回波的模擬，具有很好的工程應(yīng)用價值。
  • 關(guān)鍵字： 雷達回波實時模擬器  半實物仿真  FPGA  

基于FPGA的嵌入式圖像采集系統(tǒng)設(shè)計

  • 介紹了以FPGA為核心的邏輯控制模塊的數(shù)據(jù)采集系統(tǒng)的設(shè)計可以滿足實時性要求，設(shè)計中采用自頂向下的設(shè)計方法，根據(jù)不同的功能將整個系統(tǒng)劃分為若干模塊進行設(shè)計，并介紹了每個模塊的功能和實現(xiàn)方法。在設(shè)計中采用VHDL語言對各個模塊進行描述。視頻解碼芯片采用Philips公司的SAA7113H，該芯片通過I2C總線協(xié)議進行配置。實驗表明，設(shè)計可以滿足圖像采集實時性的要求。
  • 關(guān)鍵字： I2C總線  圖像處理  FPGA  

基于FPGA的電子攝像系統(tǒng)的穩(wěn)像設(shè)計

  • 穩(wěn)像系統(tǒng)的反應(yīng)速度是電子穩(wěn)像要解決的關(guān)鍵技術(shù)之一。傳統(tǒng)的基于“攝像機-圖像采集卡-計算機”模式的穩(wěn)像系統(tǒng)、圖像檢測和匹配算法全部由計算機以軟件方式實現(xiàn)。盡管當(dāng)今計算機的性能很高，能夠部分滿足單傳感器電子穩(wěn)系統(tǒng)的實時處理要求，但在以下幾個方面有著難以解決的問題：首先，其固有的串行工作方式使得單計算機難以適應(yīng)其于多傳感器視頻處理系統(tǒng)的實時穩(wěn)像，阻礙了在實際中的應(yīng)用adw欠，傳統(tǒng)的圖像采集卡中能將采集圖像數(shù)據(jù)實時傳輸給計算機，而不能傳輸給標(biāo)準(zhǔn)接口的視頻監(jiān)視設(shè)備lk之很多應(yīng)用場合對聽要求很高。因此，研制專用的電
  • 關(guān)鍵字： 隔行掃描  電子穩(wěn)像系統(tǒng)  FPGA  

FPGA設(shè)計中毛刺產(chǎn)生原因及消除

  • 毛刺問題在FPGA設(shè)計中非常關(guān)鍵，只有深刻理解毛刺的本質(zhì)，才有可能真正掌握設(shè)計的精髓，本文就FPGA設(shè)計中的毛刺問題進行了深入的探討，分析其產(chǎn)生的原因和條件，給出了幾種常用的消除方法，希望對FPGA設(shè)計者有一定的參考作用。
  • 關(guān)鍵字： 毛刺  同步脈沖  FPGA  

基于FPGA的測試控制板卡的設(shè)計與實現(xiàn)

  • 設(shè)計了一種以FPGA作為中心控制器件,配以多路模擬信號采集與輸出通道和多路數(shù)字信號輸入輸出通道,具有RS-232和RS-422串口通信功能的測試控制板卡。在Quartus 117.2編程平臺下,編輯了數(shù)據(jù)采集、處理和控制以及通信的硬件描述語言程序。經(jīng)應(yīng)用測試,滿足二維平臺系統(tǒng)的技術(shù)要求,具有良好的穩(wěn)定性和可升級性。
  • 關(guān)鍵字： 測試控制  模擬信號  FPGA  

基于FPGA的數(shù)字溫度測量儀設(shè)計

  • 溫度測量儀是一種常用的檢測儀器，文章中利用FPGA器件和DS18B20傳感器設(shè)計實現(xiàn)了一種數(shù)字溫度測量儀，用于室溫的檢測。該測量儀具有結(jié)構(gòu)簡單、抗干擾能力強、精確性高、轉(zhuǎn)換速度快、擴展性好等優(yōu)點。
  • 關(guān)鍵字： 溫度傳感器  VHDL  FPGA  

基于FGPA的數(shù)字密碼鎖設(shè)計

  • 設(shè)計選用FPGA芯片、4×4矩陣鍵盤、七段數(shù)碼管為主要硬件，設(shè)計了一種低功耗、體積小的密碼鎖，并在硬件上驗證了其可靠性。由于FPGA的靈活性，密碼長度可根據(jù)寄存器個數(shù)而隨意改變，此設(shè)計在現(xiàn)代物聯(lián)網(wǎng)技術(shù)中將有廣泛應(yīng)用。
  • 關(guān)鍵字： 電子鎖  狀態(tài)機  FPGA  

基于FPGA的級聯(lián)H橋多電平變流器CPS-PWM觸發(fā)脈沖快速生成

  • 提出一種基于現(xiàn)場可編程門陣列(FPGA)及不對稱規(guī)則采樣的級聯(lián)H橋型變流器觸發(fā)脈沖的快速生成方法。詳細分析了基于不對稱規(guī)則采樣的載波相移SPWM(CPS-SPWM)觸發(fā)脈沖的快速生成原理。重點介紹了基于FPGA的CPS-SPWM觸發(fā)脈沖快速生成的實現(xiàn)方法。理論分析和實驗結(jié)果表明，在既沒有增加采樣頻率，又沒有增加計算量的情況下，相對基于對稱規(guī)則采樣的CPS-SPWM脈沖生成方法，該方法具有較快的生成速度，并可廣泛應(yīng)用于DSTATCOM等高壓級聯(lián)H橋多電平變流器觸發(fā)脈沖的快速生成。
  • 關(guān)鍵字： 脈沖形成  CPS-SPWM技術(shù)  FPGA  

基于FPGA的FOR循環(huán)并行CRC流水線算法

  • 通過研究通用串行循環(huán)冗余校驗(CRC)編碼技術(shù)并在此基礎(chǔ)上,利用等式代換或矩陣變換等方法推導(dǎo)出通用并行CRC編碼電路結(jié)構(gòu)。根據(jù)傳統(tǒng)的并行CRC編碼方法,發(fā)現(xiàn)在高速數(shù)據(jù)傳輸校驗中,需要大量的人為計算量,由于計算量大,容易產(chǎn)生一些計算錯誤。于是在傳統(tǒng)的串行CRC編碼的思想基礎(chǔ)上,利用FOR循環(huán)語句與流水線技術(shù)相結(jié)合,提出基于FPGA的FOR循環(huán)并行CRC流水線算法。
  • 關(guān)鍵字： 循環(huán)冗余校驗  流水線技術(shù)  FPGA  
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