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Niosll和USB接口的高速數(shù)據(jù)采集卡設(shè)計

  • Niosll和USB接口的高速數(shù)據(jù)采集卡設(shè)計, 引 言  隨著現(xiàn)代工業(yè)生產(chǎn)和科學(xué)研究對數(shù)據(jù)采集的要求日益提高,在瞬態(tài)信號測量、圖像信號處理等一些高速、高精度的測量中,都迫切需要進(jìn)行高速數(shù)據(jù)采集(如雷達(dá)信號分析、超音波信號分析);而進(jìn)行數(shù)字處理的先決條
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基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計與實(shí)現(xiàn)

  • 基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計與實(shí)現(xiàn),介紹一種基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng),并詳細(xì)闡述了系統(tǒng)的結(jié)構(gòu)和軟硬件的實(shí)現(xiàn)方案。
      關(guān)鍵詞:高速數(shù)據(jù)采集;CPLD;嵌入式系統(tǒng)Design and Implementation of Highspeed Data Sampling System Ba s
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如何選擇合適元件用于高速數(shù)字通信系統(tǒng)的熱插拔電路設(shè)計

  • 目前有很多工程師在開發(fā)高速數(shù)字電路板,其中設(shè)計熱插拔電路以提高電路板功效是一件非常有挑戰(zhàn)性的工作。本文將介紹熱插拔設(shè)計基礎(chǔ),并著重說明不同類型熱插拔控制器的利弊,然后詳細(xì)講述熱插拔三個關(guān)鍵部件的選擇過
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ARM設(shè)計的高速數(shù)據(jù)采集遠(yuǎn)程監(jiān)控系統(tǒng)技術(shù)

  • ARM設(shè)計的高速數(shù)據(jù)采集遠(yuǎn)程監(jiān)控系統(tǒng)技術(shù),摘要:簡要介紹了TCP/IP協(xié)議,給出了基于ARM嵌入式高速數(shù)據(jù)采集裝置的遠(yuǎn)程監(jiān)控系統(tǒng)的實(shí)現(xiàn)方案。系統(tǒng)以下位機(jī)作為客戶端,在A~f91RM9200和嵌入式Linux搭建的軟硬件平臺上運(yùn)行;將上位機(jī)作為服務(wù)器端,用VB6.0開發(fā)監(jiān)
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高速電路傳輸線效應(yīng)和信號完整性問題分析

  • 隨著系統(tǒng)設(shè)計復(fù)雜性和集成度的大規(guī)模提高,電子系統(tǒng)設(shè)計師們正在從事100MHZ以上的電路設(shè)計,總線的工作頻率也已經(jīng)達(dá)到或者超過50MHZ,有一大部分甚至超過100MHZ。目前約80% 的設(shè)計的時鐘頻率超過50MHz,將近50% 以上
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基于FPGA的高速卷積的硬件設(shè)計實(shí)現(xiàn)

  • 基于FPGA的高速卷積的硬件設(shè)計實(shí)現(xiàn), 在數(shù)字信號處理領(lǐng)域,離散時間系統(tǒng)的輸出響應(yīng),可以直接由輸入信號與系統(tǒng)單位沖激響應(yīng)的離散卷積得到。離散卷積在電子通信領(lǐng)域應(yīng)用廣泛,是工程應(yīng)用的基礎(chǔ)。如果直接在時域進(jìn)行卷積,卷積過程中所必須的大量乘法和
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高速電路接地研究

  •  知識豐富的高速PCB設(shè)計者們可以容易地察覺形成連續(xù)地的難度,并且想象某處該有地,盡管想象中的地根本就不存在。在PCB上,導(dǎo)線和/或印刷線(runs)看上去好像是完好的地,可是在高速或高頻電路里卻成為電感或捉摸不定
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高速數(shù)據(jù)應(yīng)用中ESD抑制技術(shù)簡介

  • 通過采用間隙技術(shù)(gap technology),特別是采用空氣作為間隙,已經(jīng)在低電容抑制器、更低漏電流、更低鉗位電壓等方面實(shí)現(xiàn)了可觀的性能提升。總之,在重復(fù)多次或持續(xù)的ESD事件后,聚合物間隙抑制器會降級,而空氣間隙器件仍將保持非常低的電容、漏電流和觸發(fā)電壓,即使在1s事件間隔內(nèi)經(jīng)過1000次ESD事件,也能保持良好的性能。
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高速DSP系統(tǒng)的電路板級電磁兼容性設(shè)計

  • 高速DSP系統(tǒng)的電路板級電磁兼容性設(shè)計, 隨著高速DSP技術(shù)的廣泛應(yīng)用,相應(yīng)的高速DSP的PCB設(shè)計就顯得十分重要。由于DSP是一個相當(dāng)復(fù)雜、種類繁多并有許多分系統(tǒng)的數(shù)、?;旌舷到y(tǒng),所以來自外部的電磁輻射以及內(nèi)部元器件之間、分系統(tǒng)之間和各傳輸通道間的串
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高速并行RS解碼器

  • 高速并行RS解碼器,  1 引言  Reed-Solomon(簡稱RS)碼是差錯控制領(lǐng)域中一類重要的線性分組碼,具有較強(qiáng)的糾正突發(fā)錯誤和隨機(jī)錯誤的能力,廣泛應(yīng)用于各種差錯控制領(lǐng)域。RS解碼器可在FPGA或ASIC上實(shí)現(xiàn)IP核。但目前國內(nèi)RS編碼速度約為
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基于DAC芯片AD9248和CY7C09449的PCI高速數(shù)據(jù)采集方案

  • 基于DAC芯片AD9248和CY7C09449的PCI高速數(shù)據(jù)采集方案,  0 引言  數(shù)據(jù)采集向高精度和高速度兩個方向發(fā)展。高精度數(shù)據(jù)采集依賴于A/D器件的精度,高速度數(shù)據(jù)采集不僅依賴于A/D器件的速度還依賴于數(shù)據(jù)采集系統(tǒng)的設(shè)計。高速數(shù)據(jù)采集按是否可連續(xù)采集而可以分為兩類。第一
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采用LVDS高速串行總線技術(shù)的傳輸方案

  • 引言   

    在某型雷達(dá)信號處理系統(tǒng)中,要求由上位機(jī)(普通PC)實(shí)時監(jiān)控雷達(dá)系統(tǒng)狀態(tài)并采集信號處理機(jī)的關(guān)鍵變量,這就要求在處理機(jī)與上位機(jī)之間建立實(shí)時可靠的連接。同時,上位機(jī)也能對信號處理板進(jìn)行控制,完成諸如
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嵌入式高速多通道大緩存AD采集板卡方案

  • 嵌入式高速多通道大緩存AD采集板卡方案,高速多通道實(shí)時數(shù)據(jù)采集系統(tǒng)的方案在工業(yè)監(jiān)控、環(huán)境監(jiān)測等方面的應(yīng)用非常廣泛。隨著科學(xué)技術(shù)的發(fā)展,數(shù)據(jù)采集技術(shù)正向著高精度、高速度、穩(wěn)定可靠、集成化及實(shí)時系統(tǒng)的方向發(fā)展。并且通過搭載了最新的FPGA,使得產(chǎn)品
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便攜式設(shè)計的高速視頻總線設(shè)計挑戰(zhàn)

  • 在投影技術(shù)主要采用CRT屏幕的年代,視頻數(shù)據(jù)大多被編碼為模擬信號,并且在阻抗受到控制的環(huán)境中可達(dá)到絕佳的傳輸效果。但模擬顯示器并不適用于便攜式電子產(chǎn)品。直到液晶顯示器的問世,便攜設(shè)備才真正能顯示視頻,視頻接口從此便完全數(shù)字化。對屏幕分辨率要求較低的小屏幕而言,CPU接口是最常見的解決方案。這只是一種從視頻來源到顯示器的平行數(shù)據(jù)總線,驅(qū)動的方式與內(nèi)存總線相同。顯示器內(nèi)部的區(qū)域單元格緩沖器(local frame buffer)可支持速度相當(dāng)慢的微處理器。
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