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基于FPGA的違章車輛視頻檢測系統(tǒng)

近年來，ITS在城市交通管理方面得到了普遍應用，在緩解道路交通、防范交通違章及事故發(fā)生等方面獲得了良好的效果。本文針對ITS應用，特別是電子警察系統(tǒng)的應用，提出了車輛違章視頻檢測方案，以適應ITS的發(fā)展需求。
關鍵字：車輛違章檢測電子警察 FPGA

基于FPGA的慢門限恒虛警處理電路設計及其仿真

雷達信號的檢測多是在干擾背景下進行，如何從干擾中提取目標信號，不僅要求有一定的信噪比，而且必需有恒虛警處理設備。恒虛警處理是雷達信號處理的重要組成部分，慢門限恒虛警處理主要是針對接收機熱噪聲，文中介紹一種基于FPGA嵌入式設計的慢門限恒虛警處理電路，給出了仿真模型及仿真結果，并已將其用于某檢測器中，取得了良好的經(jīng)濟效益。
關鍵字：慢門限恒虛警處理電路內部噪聲 FPGA

基于Xilinx FPGA的DCM動態(tài)重配置方法研究及實現(xiàn)

介紹了Xilinx FPGA中DCM的結構和相關特性，提出了一種基于Xilinx FPGA的DCM動態(tài)重配置的原理方法，并給出了一個具體的實現(xiàn)系統(tǒng)。系統(tǒng)僅通過外部和Xilinx XC4VFX100相連的少數(shù)控制線，就可以在輸入100 MHz時鐘源的條件下，對DCM進行50～300 MHz范圍內準確、快速地變頻。本設計系統(tǒng)具有接口簡單、實時性強、穩(wěn)定性高等特點，目前已成功應用到某星載系統(tǒng)中。
關鍵字： DCM配置時鐘源 FPGA

并行CRC算法在FPGA上的實現(xiàn)

循環(huán)冗余碼校驗CRC（Cyclic Redundancy Check）廣泛用于通訊領域和數(shù)據(jù)存儲的數(shù)據(jù)檢錯?；贔PGA在通訊領域和數(shù)據(jù)存儲的應用越來越廣泛,CRC的編碼解碼模塊已經(jīng)是FPGA上的常用模塊了。采用超前位計算實現(xiàn)CRC在FPGA上的并行運算,通過實際應用證明該算法能有效實現(xiàn)硬件的速度與資源合理平衡。
關鍵字：數(shù)據(jù)檢錯 CRC FPGA

基于FPGA的虛擬邏輯分析儀的設計

提出了一種基于FPGA的虛擬邏輯分析儀的設計。該系統(tǒng)對采集到的模擬或數(shù)字信號進行存儲、處理和邏輯分析。通過FPGA控制數(shù)據(jù)單次或連續(xù)采集、緩沖，通過PCI總線將緩沖區(qū)數(shù)據(jù)轉移到硬盤管理卡，由硬盤管理卡將數(shù)據(jù)存入海量硬盤。
關鍵字：虛擬邏輯分析儀 PCI總線 FPGA

基于FPGA的ISA總線／MMи總線接口轉換設計

某型導彈測試設備控制總線為通用的ISA總線，而通信接口總線為非標準的MMи總線。在此以FPGA為核心設計了一種ISA總線／MMи總線轉換電路，該電路可以完成2種制式的數(shù)據(jù)和控制指令轉換。給出了轉換電路原理框圖、FPGA配置電路和地址比較電路原理圖。實驗結果表明該電路具有轉換數(shù)據(jù)準確，工作可靠等優(yōu)點。實際應用表明，該電路完全能達到測試設備的要求。
關鍵字： MMи總線測試設備 FPGA

基于ARM和FPGA的服務機器人運動控制系統(tǒng)研究

介紹了一種基于ARM和FPGA的嵌入式控制系統(tǒng)，該系統(tǒng)既能獨立運行又能在計算機輔助下運行，是一種兼具柔性和開放性的系統(tǒng)。利用ARM的強大的數(shù)據(jù)流轉換功能和FPGA的快速配置能力，實現(xiàn)硬件可重構。給出了系統(tǒng)的總體結構、ARM和FPGA之間的通信設計，重點給出了基于NiosII的嵌入式可重構底層控制設計，PWM功能模塊在FPGA上的實現(xiàn)。設計的系統(tǒng)集成度高、靈活。實驗表明系統(tǒng)具有高可靠性，能滿足服務機器人外圍器件多樣性控制的要求。ARM和FPGA不僅可以并行運行處理數(shù)據(jù)，其之間又可以互相通信，實現(xiàn)了系統(tǒng)的擴展
關鍵字：硬件可重構 NiosII FPGA

基于FPGA/SOPC的預測控制器設計與實現(xiàn)

針對模型預測控制在微型設備及嵌入式系統(tǒng)應用中的實時性問題,從硬件實現(xiàn)控制算法的角度研究了基于FPGA（field programmable gate array）的預測控制器的設計和實現(xiàn)。采用基于Nios II嵌入式軟核處理器的FPGA/SOPC（system on pro-grammable chip,可編程片上系統(tǒng)）方案,在FPGA芯片上構建SOPC系統(tǒng),設計SOPC的硬件及軟件系統(tǒng),實現(xiàn)了基于FPGA的預測控制器;建立了基于FPGA和dSPACE系統(tǒng)的實時仿真平臺,并進行了控制器實時仿真實驗。實時
關鍵字：模型預測控制 SOPC FPGA

基于信元的FIFO設計在FPGA上的實現(xiàn)

設計工程師通常在FPGA上實現(xiàn)FIFO(先進先出寄存器)的時候，都會使用由芯片提供商所提供的FIFO。本文提供了一種基于信元的FIFO設計方法以供設計者在適當?shù)臅r候選用。這種方法也適合于不定長包的處理。
關鍵字： FIFO 信元 FPGA

基于FPGA的數(shù)字視頻接口轉換設備

本文從實際應用的角度出發(fā)，采用FPGA作為主控芯片，設計了一款數(shù)字視頻接口轉換設備，該設備針對于MT9M111這款數(shù)字圖像傳感器產(chǎn)生的ITU-R BT.656格式數(shù)據(jù)進行采集、色彩空間變換、分辨率轉換等操作，完成了從ITU-R BT.656格式數(shù)據(jù)到DVI格式數(shù)據(jù)的轉換，使得MT9M111數(shù)字圖像傳感器的BT656數(shù)據(jù)格式圖像能夠以1280×960(60Hz)和1280×1024(60Hz)兩種顯示格式在DVI-I接口的顯示器上顯示，并且還具有圖像靜止功能，在系統(tǒng)空閑時的待機狀態(tài)實現(xiàn)了整機的低功耗，適用于
關鍵字：圖像分辨率視頻接口轉換 FPGA

滿足28nm迫切的低功耗需求

Altera低功耗28-nm器件的優(yōu)點包括，降低產(chǎn)品成本，降低或者放寬功耗預算，較低的散熱要求，能夠滿足更多的市場需求，在同樣的散熱和功耗預算內進一步提高性能等。采用最全面的方法降低28-nm產(chǎn)品的功耗，Altera幫助設計人員滿足了迫切的低功耗需求。
關鍵字： Altera 28nm FPGA

基于改進的布斯算法的嵌入FPGA的乘法器設計

設計了一款嵌入FPGA的乘法器，該乘法器能夠滿足兩個18 b有符號或17 b無符號數(shù)的乘法運算。該設計基于改進的布斯算法，提出了一種新的布斯譯碼和部分積結構，并對9-2壓縮樹和超前進位加法器進行了優(yōu)化。該乘法器采用TSMC 0．18μn CMOS工藝，其關鍵路徑延遲為3．46 ns。
關鍵字：布斯算法 18×18乘法器 FPGA

基于ATE的FPGA測試

隨著集成電路技術的飛速發(fā)展，F(xiàn)PGA的應用越來越廣泛，其測試技術也得到了廣泛重視和研究。文章簡要介紹了FPGA的發(fā)展及其主要組成部分，提出了一種用ATE對FPGA進行測試的方法和具體測試流程。
關鍵字： AutomaticTestEquipment 配置數(shù)據(jù) FPGA

基于FPGA的DDS IP核設計及仿真

以Altera公司的QuartusⅡ7．2作為開發(fā)工具，研究了基于FPGA的DDS IP核設計，并給出基于Signal TapⅡ嵌入式邏輯分析儀的仿真測試結果。將設計的DDS IP核封裝成為SOPC Builder自定義的組件，結合32位嵌入式CPU軟核NiosII，構成可編程片上系統(tǒng)(SOPC)，利用極少的硬件資源實現(xiàn)了可重構信號源。該系統(tǒng)基本功能都在FPGA芯片內完成，利用SOPC技術，在一片F(xiàn)PGA芯片上實現(xiàn)了整個信號源的硬件開發(fā)平臺，達到既簡化電路設計、又提高系統(tǒng)穩(wěn)定性和可靠性的目的。
關鍵字：直接數(shù)字頻率合成 IP核 FPGA

基于FPGA的遺傳算法組合邏輯電路設計

基于遺傳算法的組合邏輯電路的自動設計，依據(jù)給出的真值表，利用遺傳算法自動生成符合要求的組合邏輯電路。由于遺傳算法本身固有的并行性，采用軟件實現(xiàn)的方法在速度上往往受到本質是串行計算的計算機制約，因此采用硬件化設計具有重要的意義。為了證明基于FPGA的遺傳算法的高效性，設計了遺傳算法的各個模塊，實現(xiàn)了基于FPGA的遺傳算法。
關鍵字：遺傳算法自然進化 FPGA

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fpga 介紹

FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內部包括可 [ 查看詳細 ]