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EEPW首頁(yè) >> 主題列表 >> cadence?

瑞昱獲授權(quán)使用Cadence Tensilica HiFi 音頻/語(yǔ)音DSP IP內(nèi)核

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS)日前宣布，瑞昱半導(dǎo)體公司(Realtek Semiconductor Corp)獲得Cadence Tensilica(Cadence? Tensilica?)授權(quán)，可使用HiFi 音頻/語(yǔ)音DSP(數(shù)字信號(hào)處理器)IP內(nèi)核，配合Sensory公司(IC和嵌入式軟件解決方案提供商)的TrulyHandsFree?方案一起，用以實(shí)現(xiàn)長(zhǎng)時(shí)開(kāi)啟(Always-on)語(yǔ)音控制與識(shí)別技術(shù)。
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華力開(kāi)發(fā)55納米平臺(tái)的參考設(shè)計(jì)流程

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS)與上海華力微電子有限公司，日前共同宣布華力微電子基于Cadence ? Encounter? 數(shù)字技術(shù)交付出55納米平臺(tái)的參考設(shè)計(jì)流程。從現(xiàn)在起，華力微電子首次在其已建立的55 納米工藝平臺(tái)上實(shí)現(xiàn)了從 RTL到GDSII的完整流程，它也是Cadence與上海華力緊密合作的結(jié)果。
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ST、ARM和Cadence聯(lián)合向Accellera提交三個(gè)新方案

Cadence推出用于PCIe 3.0的SpeedBridge Adapter

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS)日前宣布推出全新用于PCIe 3.0的SpeedBridge? Adapter。它為設(shè)計(jì)師們提供了一個(gè)重要的工具，來(lái)驗(yàn)證和確認(rèn)他們的PCI Express (PCIe) 設(shè)計(jì)。
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Cadence協(xié)助創(chuàng)意、聯(lián)電克服先進(jìn)制程設(shè)計(jì)挑戰(zhàn)

  • 益華電腦(Cadence Design Systems)近日宣布兩項(xiàng)成功合作案例，其一為設(shè)計(jì)服務(wù)業(yè)者創(chuàng)意電子(GUC)運(yùn)用Cadence Encounter數(shù)位設(shè)計(jì)實(shí)現(xiàn)系統(tǒng)(Digital Implementation System，EDI)與Cadence Litho Physical Analyzer，成功地完成了20nm系統(tǒng)晶片(SoC)測(cè)試晶片的試產(chǎn)。此外晶圓代工大廠聯(lián)電(UMC)已經(jīng)采用Cadence 「設(shè)計(jì)中(in-design)」與signoff DFM (design-for-manufa
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聯(lián)華28納米節(jié)點(diǎn)采用Cadence物理和電學(xué)制造性設(shè)計(jì)簽收解決方案

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS)日前宣布，歷經(jīng)廣泛的基準(zhǔn)測(cè)試后，半導(dǎo)體制造商聯(lián)華電子(NYSE：UMC;TWSE：2303)(UMC)已采用Cadence? “設(shè)計(jì)內(nèi)”和“簽收”可制造性設(shè)計(jì)(DFM)流程對(duì)28納米設(shè)計(jì)進(jìn)行物理簽收和電學(xué)變量?jī)?yōu)化。
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Cadence采用全新可支持電學(xué)感知設(shè)計(jì)的Virtuoso版圖套件

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS) 日前宣布推出用于實(shí)現(xiàn)電學(xué)感知設(shè)計(jì)的Virtuoso?版圖套件，它是一種開(kāi)創(chuàng)性的定制設(shè)計(jì)方法，能提高設(shè)計(jì)團(tuán)隊(duì)的設(shè)計(jì)生產(chǎn)力和定制IC的電路性能。
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臺(tái)積電TSMC擴(kuò)大與Cadence在Virtuoso定制設(shè)計(jì)平臺(tái)的合作

  • 為專(zhuān)注于解決先進(jìn)節(jié)點(diǎn)設(shè)計(jì)的日益復(fù)雜性，全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS) 日前宣布，臺(tái)積電已與Cadence在Virtuoso定制和模擬設(shè)計(jì)平臺(tái)擴(kuò)大合作以設(shè)計(jì)和驗(yàn)證其尖端IP。
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Cadence解決方案助力創(chuàng)意電子20納米SoC測(cè)試芯片成功流片

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS) 日前宣布，設(shè)計(jì)服務(wù)公司創(chuàng)意電子(GUC)使用Cadence? Encounter?數(shù)字實(shí)現(xiàn)系統(tǒng)(EDI)和Cadence光刻物理分析器成功完成20納米系統(tǒng)級(jí)芯片(SoC)測(cè)試芯片流片。雙方工程師通過(guò)緊密合作，運(yùn)用Cadence解決方案克服實(shí)施和可制造性設(shè)計(jì)(DFM)驗(yàn)證挑戰(zhàn)，并最終完成設(shè)計(jì)。
  • 關(guān)鍵字： Cadence  DFM  

Cadence解決方案助力創(chuàng)意電子20納米SoC測(cè)試芯片成功流片

  • 　　Cadence Encounter數(shù)字實(shí)現(xiàn)系統(tǒng)與Cadence光刻物理分析器 　　可降低風(fēng)險(xiǎn)并縮短設(shè)計(jì)周期 　　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS) 今天宣布，設(shè)計(jì)服務(wù)公司創(chuàng)意電子(GUC)使用Cadence? Encounter?數(shù)字實(shí)現(xiàn)系統(tǒng)(EDI)和Cadence光刻物理分析器成功完成20納米系統(tǒng)級(jí)芯片(SoC)測(cè)試芯片流片。雙方工程師通過(guò)緊密合作，運(yùn)用Cadence解決方案克服實(shí)施和可制造性設(shè)計(jì)(DFM)驗(yàn)證挑戰(zhàn)，并最終完成設(shè)計(jì)。 　　在開(kāi)發(fā)過(guò)程中
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Cadence：Tempus時(shí)序簽收加速SoC設(shè)計(jì)

  • 為簡(jiǎn)化和加速?gòu)?fù)雜IC的開(kāi)發(fā)，Cadence 設(shè)計(jì)系統(tǒng)公司不久前推出Tempus時(shí)序簽收解決方案。這是一款新的靜態(tài)時(shí)序分析與收斂工具，旨在幫助系統(tǒng)級(jí)芯片 (SoC) 開(kāi)發(fā)者加速時(shí)序收斂，將芯片設(shè)計(jì)快速轉(zhuǎn)化為可制造的產(chǎn)品。
  • 關(guān)鍵字： Cadence  Tempus  CPU  201307  

臺(tái)積電認(rèn)可Cadence Tempus時(shí)序簽收工具用于20納米設(shè)計(jì)

  • Cadence日前宣布，臺(tái)積電(TSMC)在20納米制程對(duì)全新的Cadence Tempus時(shí)序簽收解決方案提供了認(rèn)證。該認(rèn)證意味著通過(guò)臺(tái)積電嚴(yán)格的EDA工具驗(yàn)證過(guò)的Cadence Tempus 時(shí)序簽收解決方案能夠確?？蛻?hù)實(shí)現(xiàn)先進(jìn)制程節(jié)點(diǎn)的最高精確度標(biāo)準(zhǔn)。
  • 關(guān)鍵字： Cadence  臺(tái)積電  Tempus  

Cadence為復(fù)雜SoC設(shè)計(jì)縮短時(shí)序收斂時(shí)程

  • 　　在加速?gòu)?fù)雜IC開(kāi)發(fā)更容易的當(dāng)下，益華電腦(Cadence Design Systems, Inc.)發(fā)表 Tempus 時(shí)序 Signoff解決方案(Timing Signoff Solution)，這是嶄新的靜態(tài)時(shí)序分析與收斂工具，精心設(shè)計(jì)讓系統(tǒng)晶片(System-on-Chip，SoC)開(kāi)發(fā)人員能夠加速時(shí)序收斂，讓晶片設(shè)計(jì)更快速地投入制造流程。Tempus 時(shí)序Signoff解決方案意謂全新的時(shí)序signoff工具作法，讓客戶(hù)能夠縮短時(shí)序signoff收斂與分析，實(shí)現(xiàn)更快速的試產(chǎn)，同時(shí)創(chuàng)造良率更高
  • 關(guān)鍵字： Cadence  SoC設(shè)計(jì)  

Cadence推出Tempus時(shí)序簽收解決方案

  • 　　為設(shè)計(jì)收斂和簽收提供前所未有的性能和容量 　　Tempus?時(shí)序簽收解決方案提供的性能比傳統(tǒng)的時(shí)序分析解決方案提升了一個(gè)數(shù)量級(jí)。 　　可擴(kuò)展性，能夠?qū)哂猩蟽|個(gè)實(shí)例的設(shè)計(jì)進(jìn)行全扁平化分析。 　　集成的簽收精度的時(shí)序收斂環(huán)境利用創(chuàng)新的考慮物理layout的ECO技術(shù)，可以使設(shè)計(jì)閉合提前數(shù)周時(shí)間。 　　為簡(jiǎn)化和加速?gòu)?fù)雜IC的開(kāi)發(fā)，Cadence 設(shè)計(jì)系統(tǒng)公司推出Tempus? 時(shí)序簽收解決方案。這是一款新的靜態(tài)時(shí)序分析與收斂工具，旨在幫助系統(tǒng)級(jí)芯片 (SoC) 開(kāi)發(fā)者加速時(shí)序收斂，將芯片設(shè)計(jì)快速轉(zhuǎn)
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Cadence Incisive Enterprise Simulator將低功耗驗(yàn)證效率提升30%

  • 　　【中國(guó)，2013年5月14日】全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，近日推出新版本Incisive Enterprise Simulator，該版本將復(fù)雜SoC的低功耗驗(yàn)證效率提高了30%。13.1版的Cadence  Incisive Enterprise Simulator致力于解決低功耗驗(yàn)證的問(wèn)題，包括高級(jí)建模、調(diào)試、功率格式支持，并且為當(dāng)今最復(fù)雜的SoC提供了更快的驗(yàn)證方式。 　　Incisive SimVision Debugger的最新
  • 關(guān)鍵字： Cadence  SoC  
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