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FPGA實戰(zhàn)演練邏輯篇3:FPGA與CPLD
- 盡管很多人聽說過FPGA和CPLD,但是關(guān)于FPGA與CPLD之間的區(qū)別,了解的人可能不是很多。雖然FPGA與CPLD都是“可反復(fù)編程的邏輯器件”,但是在技術(shù)上
- 關(guān)鍵字: FPGA 實戰(zhàn)演練 CPLD
FPGA 6部分組成基本結(jié)構(gòu)簡析
- FPGA由6部分組成,分別為可編程輸入/輸出單元、基本可編程邏輯單元、嵌入式塊RAM、豐富的布線資源、底層嵌入功能單元和內(nèi)嵌專用硬核等。每個單元
- 關(guān)鍵字: FPGA 基本結(jié)構(gòu) 簡析
基于FPGA的DDR3控制器設(shè)計
- 基于FPGA的DDR3控制器設(shè)計,摘要 介紹了DDR3 SDRAM的技術(shù)特點、工作原理,以及控制器的構(gòu)成。利用Xilinx公司的MIG軟件工具在Virtex-6系列FPGA芯片上,實現(xiàn)了控制器的設(shè)計方法,并給出了ISim仿真驗證結(jié)果,驗證了該設(shè)計方案的可行性。DDR3 SDRAM
- 關(guān)鍵字: FPGA DDR3 SDRAM控制器 MIG ISim
混合同余法產(chǎn)生隨機(jī)噪聲的FPGA實現(xiàn)
- 混合同余法產(chǎn)生隨機(jī)噪聲的FPGA實現(xiàn),摘要:隨著電子對抗技術(shù)的快速發(fā)展,在有源式干擾機(jī)中需要用到數(shù)字高斯白噪聲。通過對混合同余法產(chǎn)生隨機(jī)序列的原理研究,本文提出了一種利用FPGA產(chǎn)生高斯白噪聲的方法。該方法在PC主控端的控制下,采用ROM查找表的方
- 關(guān)鍵字: 高斯白噪聲 混合同余法 FPGA Verilog HDL
基于FPGA的無刷直流電機(jī)調(diào)速系統(tǒng)設(shè)計與實現(xiàn)
- 摘要:以FPGA為控制器,使用霍爾傳感器進(jìn)行電機(jī)電流及位置的檢測,用MOSFET搭接成的驅(qū)動電路進(jìn)行控制電機(jī)的轉(zhuǎn)速和轉(zhuǎn)向,用VHDL語言設(shè)計了一種PWM調(diào)節(jié)
- 關(guān)鍵字: FPGA 無刷直流電機(jī) 霍爾傳感器 PWM調(diào)節(jié) BLDC
基于FPGA的脈沖耦合神經(jīng)網(wǎng)絡(luò)的硬件實現(xiàn)
- 摘要:針對脈沖耦合神經(jīng)網(wǎng)絡(luò)(PCNN)具有神經(jīng)元脈沖同步激發(fā)、適合硬件實現(xiàn)的特點,提出了一種基于FPGA的PCNN實時處理系統(tǒng)。系統(tǒng)設(shè)計了時鐘分頻、串口
- 關(guān)鍵字: 脈沖耦合神經(jīng)網(wǎng)絡(luò) 硬件實現(xiàn) FPGA 圖像處理
EDA環(huán)境銜接測量軟件 電子產(chǎn)品開發(fā)周期大幅縮短
- 消費性電子產(chǎn)品汰換周期越來越短,且功能復(fù)雜度不斷提高,使得系統(tǒng)研發(fā)人員面臨縮短產(chǎn)品開發(fā)時間的嚴(yán)峻挑戰(zhàn)。所幸,現(xiàn)今自動化測試系統(tǒng)已開始
- 關(guān)鍵字: 測試系統(tǒng) 微處理器 FPGA
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